Verilog HDL計算機網絡典型電路算法設計與實現 9787302687856 喬廬峰 陳慶華 晉軍等

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書名：Verilog HDL計算機網絡典型電路算法設計與實現
ISBN：9787302687856
出版社：清華大學
著編譯者：喬廬峰 陳慶華 晉軍等
頁數：196
所在地：中國大陸 *此為代購商品
書號：1735345
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【台灣高等教育出版社簡體書】 Verilog HDL計算機網絡典型電路算法設計與實現 787302687856 喬廬峰 陳慶華 晉軍等

內容簡介

本書圍繞計算機網絡中路由器的基本構成，精選在計算機網絡領域廣泛應用的5類典型電路，包括基於Trie的IP路由查找電路、SDN流表電路、空分交換單元、共享存儲交換單元和複雜隊列管理器等，給出全部電路的算法原理、電路結構、RTL設計和模擬驗證代碼。書中的所有代碼都在FPGA開發環境上進行實際驗證，可以直接應用於讀者的設計實踐中，具有良好的參考價值。 本書主要面向具有一定Verilog HDL語法基礎，著手進行大規模數字系統設計的電子技術、計算機、通信和網絡領域的高年級本科生、研究生和已經進入工作崗位的工程技術人員。

目錄

第1章 計算機網絡典型電路概述
1 1 計算機網絡簡介
1 2 路由器的基本功能與工作原理
1 3 路由器的基本構成與技術簡介
1 3 1 路由器的基本構成
1 3 2 路由器的IP路由查找技術
1 3 3 路由器的交換結構
1 3 4 路由器的緩存排隊機制
1 3 5 路由器的常用隊列調度機制
第2章 基於Trie的路由查找算法及電路實現
2 1 基於Trie的IP路由查找算法
2 1 1 二叉樹查找原理
2 1 2 路徑壓縮Trie查找算法
2 1 3 多分支Trie查找算法
2 1 4 層級壓縮Trie查找算法
2 2 基本二進位Trie的硬體電路實現與模擬分析
2 2 1 基本二進位Trie的電路結構和算法原理
2 2 2 基本二進位Trie電路設計與模擬分析
2 3 路徑壓縮二叉樹算法與電路實現
2 3 1 路徑壓縮二叉樹的生成
2 3 2 CTrie查找電路的設計與模擬分析
第3章 SDN流表電路算法與電路實現
3 1 哈希查找算法原理
3 2 多桶哈希查找電路設計與分析
3 3 多級流表電路設計與分析
第4章 典型空分交換單元的原理與設計
4 1 單級Crossbar的功能
4 2 Crossbar的電路實現
4 2 1 in_queue電路的設計與實現
4 2 2 in_arbiter_4_stream電路的設計與實現
4 2 3 out_arbiter_4_stream電路的設計與實現
4 2 4 sequencer電路的設計
4 2 5 crossbar_top_stream電路的設計與模擬分析
第5章 共享存儲交換單元
5 1 共享存儲交換單元的工作原理
5 2 共享緩存交換結構及工作流程
5 2 1 switch_core中的自由指針隊列管理電路
5 2 2 隊列控制器電路
5 2 3 switch_core電路
第6章 常用多用戶隊列管理器與調度器電路
6 1 支持資源預留的多用戶隊列管理器
6 1 1 支持資源預留的多用戶隊列管理器電路結構
6 1 2 支持資源預留的多用戶隊列管理器設計與模擬分析
6 2 多用戶隊列調度器
6 2 1 基於漏桶算法的多用戶隊列調度器電路結構
6 2 2 多用戶隊列調度器電路的設計與模擬分析
6 3 基於DDR的多用戶隊列管理器
6 3 1 基於DDR的多用戶隊列管理器工作機制
6 3 2 基於DDR的多用戶隊列模擬代碼
參考文獻
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